Lines Matching refs:VC5_CEC_REG
158 #define VC5_CEC_REG(reg, offset) _VC4_REG(VC5_CEC, reg, offset) macro
297 VC5_CEC_REG(HDMI_CEC_CNTRL_1, 0x010),
298 VC5_CEC_REG(HDMI_CEC_CNTRL_2, 0x014),
299 VC5_CEC_REG(HDMI_CEC_CNTRL_3, 0x018),
300 VC5_CEC_REG(HDMI_CEC_CNTRL_4, 0x01c),
301 VC5_CEC_REG(HDMI_CEC_CNTRL_5, 0x020),
302 VC5_CEC_REG(HDMI_CEC_TX_DATA_1, 0x028),
303 VC5_CEC_REG(HDMI_CEC_TX_DATA_2, 0x02c),
304 VC5_CEC_REG(HDMI_CEC_TX_DATA_3, 0x030),
305 VC5_CEC_REG(HDMI_CEC_TX_DATA_4, 0x034),
306 VC5_CEC_REG(HDMI_CEC_RX_DATA_1, 0x038),
307 VC5_CEC_REG(HDMI_CEC_RX_DATA_2, 0x03c),
308 VC5_CEC_REG(HDMI_CEC_RX_DATA_3, 0x040),
309 VC5_CEC_REG(HDMI_CEC_RX_DATA_4, 0x044),
390 VC5_CEC_REG(HDMI_CEC_CNTRL_1, 0x010),
391 VC5_CEC_REG(HDMI_CEC_CNTRL_2, 0x014),
392 VC5_CEC_REG(HDMI_CEC_CNTRL_3, 0x018),
393 VC5_CEC_REG(HDMI_CEC_CNTRL_4, 0x01c),
394 VC5_CEC_REG(HDMI_CEC_CNTRL_5, 0x020),
395 VC5_CEC_REG(HDMI_CEC_TX_DATA_1, 0x028),
396 VC5_CEC_REG(HDMI_CEC_TX_DATA_2, 0x02c),
397 VC5_CEC_REG(HDMI_CEC_TX_DATA_3, 0x030),
398 VC5_CEC_REG(HDMI_CEC_TX_DATA_4, 0x034),
399 VC5_CEC_REG(HDMI_CEC_RX_DATA_1, 0x038),
400 VC5_CEC_REG(HDMI_CEC_RX_DATA_2, 0x03c),
401 VC5_CEC_REG(HDMI_CEC_RX_DATA_3, 0x040),
402 VC5_CEC_REG(HDMI_CEC_RX_DATA_4, 0x044),