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12 #include <dt-bindings/clock/qcom,gcc-sm6350.h>
14 #include "clk-alpha-pll.h"
15 #include "clk-branch.h"
16 #include "clk-rcg.h"
17 #include "clk-regmap.h"
18 #include "clk-regmap-divider.h"
19 #include "clk-regmap-mux.h"
37 .clkr = {
63 .clkr.hw.init = &(struct clk_init_data){
66 &gpll0.clkr.hw,
85 .clkr.hw.init = &(struct clk_init_data){
88 &gpll0.clkr.hw,
98 .clkr = {
124 .clkr.hw.init = &(struct clk_init_data){
127 &gpll6.clkr.hw,
137 .clkr = {
160 { .hw = &gpll0.clkr.hw },
161 { .hw = &gpll6_out_even.clkr.hw },
162 { .hw = &gpll0_out_even.clkr.hw },
172 { .hw = &gpll0_out_even.clkr.hw },
182 { .hw = &gpll0_out_odd.clkr.hw },
193 { .hw = &gpll0.clkr.hw },
194 { .hw = &gpll0_out_odd.clkr.hw },
206 { .hw = &gpll0_out_odd.clkr.hw },
208 { .hw = &gpll0_out_even.clkr.hw },
229 { .hw = &gpll6_out_even.clkr.hw },
230 { .hw = &gpll0_out_even.clkr.hw },
241 { .hw = &gpll0_out_odd.clkr.hw },
242 { .hw = &gpll7.clkr.hw },
249 .clkr.hw.init = &(struct clk_init_data) {
252 &gpll0.clkr.hw,
263 .clkr.hw.init = &(struct clk_init_data) {
266 &gpll0.clkr.hw,
284 .clkr.hw.init = &(struct clk_init_data){
307 .clkr.hw.init = &(struct clk_init_data){
321 .clkr.hw.init = &(struct clk_init_data){
335 .clkr.hw.init = &(struct clk_init_data){
355 .clkr.hw.init = &(struct clk_init_data){
396 .clkr.hw.init = &gcc_qupv3_wrap0_s0_clk_src_init,
412 .clkr.hw.init = &gcc_qupv3_wrap0_s1_clk_src_init,
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476 .clkr.hw.init = &gcc_qupv3_wrap0_s5_clk_src_init,
492 .clkr.hw.init = &gcc_qupv3_wrap1_s0_clk_src_init,
508 .clkr.hw.init = &gcc_qupv3_wrap1_s1_clk_src_init,
524 .clkr.hw.init = &gcc_qupv3_wrap1_s2_clk_src_init,
540 .clkr.hw.init = &gcc_qupv3_wrap1_s3_clk_src_init,
556 .clkr.hw.init = &gcc_qupv3_wrap1_s4_clk_src_init,
572 .clkr.hw.init = &gcc_qupv3_wrap1_s5_clk_src_init,
594 .clkr.hw.init = &(struct clk_init_data){
615 .clkr.hw.init = &(struct clk_init_data){
640 .clkr.hw.init = &(struct clk_init_data){
664 .clkr.hw.init = &(struct clk_init_data){
686 .clkr.hw.init = &(struct clk_init_data){
705 .clkr.hw.init = &(struct clk_init_data){
728 .clkr.hw.init = &(struct clk_init_data){
750 .clkr.hw.init = &(struct clk_init_data){
768 .clkr.hw.init = &(struct clk_init_data){
784 .clkr.hw.init = &(struct clk_init_data){
797 .clkr = {
803 &gcc_ufs_phy_axi_clk_src.clkr.hw,
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823 &gcc_ufs_phy_axi_clk_src.clkr.hw,
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843 &gcc_ufs_phy_axi_clk_src.clkr.hw,
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863 &gcc_usb30_prim_master_clk_src.clkr.hw,
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980 .clkr = {
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1008 .clkr = {
1014 &gcc_usb30_prim_master_clk_src.clkr.hw,
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1077 .clkr = {
1092 .clkr = {
1108 .clkr = {
1123 .clkr = {
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1157 &gpll0.clkr.hw,
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1202 &gcc_gp1_clk_src.clkr.hw,
1214 .clkr = {
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1238 &gcc_gp3_clk_src.clkr.hw,
1252 .clkr = {
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1271 &gpll0.clkr.hw,
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1287 &gcc_gpu_gpll0_main_div_clk_src.clkr.hw,
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1420 &gpll0.clkr.hw,
1430 .clkr = {
1436 &gcc_npu_pll0_main_div_clk_src.clkr.hw,
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1453 &gcc_pdm2_clk_src.clkr.hw,
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1540 &gcc_qupv3_wrap0_s0_clk_src.clkr.hw,
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1576 &gcc_qupv3_wrap0_s2_clk_src.clkr.hw,
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1692 &gcc_qupv3_wrap1_s1_clk_src.clkr.hw,
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1710 &gcc_qupv3_wrap1_s2_clk_src.clkr.hw,
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1793 .clkr = {
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1906 &gcc_sdcc2_apps_clk_src.clkr.hw,
1920 .clkr = {
1926 &gcc_cpuss_ahb_clk_src.clkr.hw,
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2054 &gcc_ufs_phy_phy_aux_clk_src.clkr.hw,
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2092 .clkr = {
2107 .clkr = {
2113 &gcc_ufs_phy_unipro_core_clk_src.clkr.hw,
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2133 &gcc_ufs_phy_unipro_core_clk_src.clkr.hw,
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2151 &gcc_usb30_prim_master_clk_src.clkr.hw,
2163 .clkr = {
2169 &gcc_usb30_prim_mock_utmi_clk_src.clkr.hw,
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2194 .clkr = {
2207 .clkr = {
2213 &gcc_usb3_prim_phy_aux_clk_src.clkr.hw,
2225 .clkr = {
2231 &gcc_usb3_prim_phy_aux_clk_src.clkr.hw,
2245 .clkr = {
2260 .clkr = {
2276 .clkr = {
2291 .clkr = {
2304 .clkr = {
2350 [GCC_AGGRE_UFS_PHY_AXI_CLK] = &gcc_aggre_ufs_phy_axi_clk.clkr,
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2361 [GCC_CE1_CLK] = &gcc_ce1_clk.clkr,
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2381 [GCC_GPU_CFG_AHB_CLK] = &gcc_gpu_cfg_ahb_clk.clkr,
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2389 [GCC_NPU_BWMON_DSP_CFG_AHB_CLK] = &gcc_npu_bwmon_dsp_cfg_ahb_clk.clkr,
2390 [GCC_NPU_CFG_AHB_CLK] = &gcc_npu_cfg_ahb_clk.clkr,
2391 [GCC_NPU_DMA_CLK] = &gcc_npu_dma_clk.clkr,
2392 [GCC_NPU_GPLL0_CLK] = &gcc_npu_gpll0_clk.clkr,
2393 [GCC_NPU_GPLL0_DIV_CLK] = &gcc_npu_gpll0_div_clk.clkr,
2394 [GCC_PDM2_CLK] = &gcc_pdm2_clk.clkr,
2395 [GCC_PDM2_CLK_SRC] = &gcc_pdm2_clk_src.clkr,
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2399 [GCC_QUPV3_WRAP0_CORE_2X_CLK] = &gcc_qupv3_wrap0_core_2x_clk.clkr,
2400 [GCC_QUPV3_WRAP0_CORE_CLK] = &gcc_qupv3_wrap0_core_clk.clkr,
2401 [GCC_QUPV3_WRAP0_S0_CLK] = &gcc_qupv3_wrap0_s0_clk.clkr,
2402 [GCC_QUPV3_WRAP0_S0_CLK_SRC] = &gcc_qupv3_wrap0_s0_clk_src.clkr,
2403 [GCC_QUPV3_WRAP0_S1_CLK] = &gcc_qupv3_wrap0_s1_clk.clkr,
2404 [GCC_QUPV3_WRAP0_S1_CLK_SRC] = &gcc_qupv3_wrap0_s1_clk_src.clkr,
2405 [GCC_QUPV3_WRAP0_S2_CLK] = &gcc_qupv3_wrap0_s2_clk.clkr,
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2407 [GCC_QUPV3_WRAP0_S3_CLK] = &gcc_qupv3_wrap0_s3_clk.clkr,
2408 [GCC_QUPV3_WRAP0_S3_CLK_SRC] = &gcc_qupv3_wrap0_s3_clk_src.clkr,
2409 [GCC_QUPV3_WRAP0_S4_CLK] = &gcc_qupv3_wrap0_s4_clk.clkr,
2410 [GCC_QUPV3_WRAP0_S4_CLK_SRC] = &gcc_qupv3_wrap0_s4_clk_src.clkr,
2411 [GCC_QUPV3_WRAP0_S5_CLK] = &gcc_qupv3_wrap0_s5_clk.clkr,
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2419 [GCC_QUPV3_WRAP1_S2_CLK] = &gcc_qupv3_wrap1_s2_clk.clkr,
2420 [GCC_QUPV3_WRAP1_S2_CLK_SRC] = &gcc_qupv3_wrap1_s2_clk_src.clkr,
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2423 [GCC_QUPV3_WRAP1_S4_CLK] = &gcc_qupv3_wrap1_s4_clk.clkr,
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2430 [GCC_QUPV3_WRAP_1_S_AHB_CLK] = &gcc_qupv3_wrap_1_s_ahb_clk.clkr,
2431 [GCC_SDCC1_AHB_CLK] = &gcc_sdcc1_ahb_clk.clkr,
2432 [GCC_SDCC1_APPS_CLK] = &gcc_sdcc1_apps_clk.clkr,
2433 [GCC_SDCC1_APPS_CLK_SRC] = &gcc_sdcc1_apps_clk_src.clkr,
2434 [GCC_SDCC1_ICE_CORE_CLK] = &gcc_sdcc1_ice_core_clk.clkr,
2435 [GCC_SDCC1_ICE_CORE_CLK_SRC] = &gcc_sdcc1_ice_core_clk_src.clkr,
2436 [GCC_SDCC2_AHB_CLK] = &gcc_sdcc2_ahb_clk.clkr,
2437 [GCC_SDCC2_APPS_CLK] = &gcc_sdcc2_apps_clk.clkr,
2438 [GCC_SDCC2_APPS_CLK_SRC] = &gcc_sdcc2_apps_clk_src.clkr,
2439 [GCC_SYS_NOC_CPUSS_AHB_CLK] = &gcc_sys_noc_cpuss_ahb_clk.clkr,
2440 [GCC_UFS_MEM_CLKREF_CLK] = &gcc_ufs_mem_clkref_clk.clkr,
2441 [GCC_UFS_PHY_AHB_CLK] = &gcc_ufs_phy_ahb_clk.clkr,
2442 [GCC_UFS_PHY_AXI_CLK] = &gcc_ufs_phy_axi_clk.clkr,
2443 [GCC_UFS_PHY_AXI_CLK_SRC] = &gcc_ufs_phy_axi_clk_src.clkr,
2444 [GCC_UFS_PHY_ICE_CORE_CLK] = &gcc_ufs_phy_ice_core_clk.clkr,
2445 [GCC_UFS_PHY_ICE_CORE_CLK_SRC] = &gcc_ufs_phy_ice_core_clk_src.clkr,
2446 [GCC_UFS_PHY_PHY_AUX_CLK] = &gcc_ufs_phy_phy_aux_clk.clkr,
2447 [GCC_UFS_PHY_PHY_AUX_CLK_SRC] = &gcc_ufs_phy_phy_aux_clk_src.clkr,
2448 [GCC_UFS_PHY_RX_SYMBOL_0_CLK] = &gcc_ufs_phy_rx_symbol_0_clk.clkr,
2449 [GCC_UFS_PHY_RX_SYMBOL_1_CLK] = &gcc_ufs_phy_rx_symbol_1_clk.clkr,
2450 [GCC_UFS_PHY_TX_SYMBOL_0_CLK] = &gcc_ufs_phy_tx_symbol_0_clk.clkr,
2451 [GCC_UFS_PHY_UNIPRO_CORE_CLK] = &gcc_ufs_phy_unipro_core_clk.clkr,
2453 &gcc_ufs_phy_unipro_core_clk_src.clkr,
2454 [GCC_USB30_PRIM_MASTER_CLK] = &gcc_usb30_prim_master_clk.clkr,
2455 [GCC_USB30_PRIM_MASTER_CLK_SRC] = &gcc_usb30_prim_master_clk_src.clkr,
2456 [GCC_USB30_PRIM_MOCK_UTMI_CLK] = &gcc_usb30_prim_mock_utmi_clk.clkr,
2458 &gcc_usb30_prim_mock_utmi_clk_src.clkr,
2459 [GCC_USB30_PRIM_SLEEP_CLK] = &gcc_usb30_prim_sleep_clk.clkr,
2460 [GCC_USB3_PRIM_CLKREF_CLK] = &gcc_usb3_prim_clkref_clk.clkr,
2461 [GCC_USB3_PRIM_PHY_AUX_CLK] = &gcc_usb3_prim_phy_aux_clk.clkr,
2462 [GCC_USB3_PRIM_PHY_AUX_CLK_SRC] = &gcc_usb3_prim_phy_aux_clk_src.clkr,
2463 [GCC_USB3_PRIM_PHY_COM_AUX_CLK] = &gcc_usb3_prim_phy_com_aux_clk.clkr,
2464 [GCC_USB3_PRIM_PHY_PIPE_CLK] = &gcc_usb3_prim_phy_pipe_clk.clkr,
2465 [GCC_VIDEO_AHB_CLK] = &gcc_video_ahb_clk.clkr,
2466 [GCC_VIDEO_AXI_CLK] = &gcc_video_axi_clk.clkr,
2467 [GCC_VIDEO_THROTTLE_AXI_CLK] = &gcc_video_throttle_axi_clk.clkr,
2468 [GCC_VIDEO_XO_CLK] = &gcc_video_xo_clk.clkr,
2469 [GPLL0] = &gpll0.clkr,
2470 [GPLL0_OUT_EVEN] = &gpll0_out_even.clkr,
2471 [GPLL0_OUT_ODD] = &gpll0_out_odd.clkr,
2472 [GPLL6] = &gpll6.clkr,
2473 [GPLL6_OUT_EVEN] = &gpll6_out_even.clkr,
2474 [GPLL7] = &gpll7.clkr,
2475 [GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK] = &gcc_ufs_phy_phy_aux_hw_ctl_clk.clkr,
2476 [GCC_UFS_PHY_AXI_HW_CTL_CLK] = &gcc_ufs_phy_axi_hw_ctl_clk.clkr,
2478 &gcc_aggre_ufs_phy_axi_hw_ctl_clk.clkr,
2480 &gcc_ufs_phy_unipro_core_hw_ctl_clk.clkr,
2482 &gcc_ufs_phy_ice_core_hw_ctl_clk.clkr,
2483 [GCC_GPU_GPLL0_MAIN_DIV_CLK_SRC] = &gcc_gpu_gpll0_main_div_clk_src.clkr,
2484 [GCC_NPU_PLL0_MAIN_DIV_CLK_SRC] = &gcc_npu_pll0_main_div_clk_src.clkr,
2539 { .compatible = "qcom,gcc-sm6350" },
2562 return qcom_cc_really_probe(&pdev->dev, &gcc_sm6350_desc, regmap); in gcc_sm6350_probe()
2568 .name = "gcc-sm6350",